Redo RAM layout
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parent
42e1fc35de
commit
3dac8e881f
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|
@ -1,8 +1,14 @@
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(version 1)
|
||||
(rule "0.15mm by default"
|
||||
(constraint track_width (min 0.15mm))
|
||||
(constraint clearance (min 0.15mm)))
|
||||
(rule "Via distance"
|
||||
(constraint hole_to_hole (min 0.3mm))
|
||||
(condition "A.Via_Type == 'Through' && B.Via_Type == 'Through'"))
|
||||
(rule "BGA neckdown"
|
||||
(constraint track_width (min 0.1mm) (opt 0.15mm))
|
||||
(constraint track_width (min 0.1mm) (opt 0.1mm))
|
||||
(constraint clearance (min 0.1mm) (opt 0.15mm))
|
||||
(constraint annular_width (min 0.075mm))
|
||||
(constraint annular_width (min 0.05mm))
|
||||
(condition "A.intersectsArea('BGA_fanout')"))
|
||||
(rule "STM fanout"
|
||||
(constraint track_width (min 0.1mm) (opt 0.15mm))
|
||||
|
|
@ -10,13 +16,20 @@
|
|||
(condition "A.intersectsArea('STM_fanout')"))
|
||||
(rule "RAM via distance"
|
||||
(constraint hole_to_hole (min 0.2mm))
|
||||
(condition "A.NetClass == 'RAM' && B.NetClass == 'RAM' && A.Via_Type == 'Through' && B.Via_Type == 'Through'"))
|
||||
(condition "A.NetClass == 'RAM' && (B.NetClass == 'RAM') && A.Via_Type == 'Through' && B.Via_Type == 'Through'"))
|
||||
(rule "RAM via size"
|
||||
(constraint annular_width (min 0.075mm))
|
||||
(condition "A.NetClass == 'RAM'"))
|
||||
(constraint annular_width (min 0.05mm))
|
||||
(constraint via_diameter (min 0.4mm))
|
||||
(condition "A.NetClass == 'RAM' || A.NetName == 'GND'"))
|
||||
(rule "RAM via clearance"
|
||||
(constraint hole_clearance (min 0.2mm))
|
||||
(condition "A.NetClass == 'RAM' && B.NetClass == 'RAM' && A.Via_Type == 'Through'"))
|
||||
(condition "(A.NetClass == 'RAM' || A.NetName == 'GND') && B.NetClass == 'RAM' && A.Via_Type == 'Through'"))
|
||||
(rule "RAM GND coupling via distance"
|
||||
(constraint hole_to_hole (min 0.2mm))
|
||||
(condition "A.NetName == 'GND' && B.NetClass == 'RAM' && A.Via_Type == 'Through' && B.Via_Type == 'Through'"))
|
||||
(rule "RAM traces"
|
||||
(constraint track_width (min 0.1mm) (opt 0.1mm))
|
||||
(condition "A.NetClass == 'RAM'"))
|
||||
# Keep 50mil clearance to high-speed signals
|
||||
(rule "USB clearance"
|
||||
(constraint clearance (min 1.27mm))
|
||||
|
|
|
|||
40402
ECAD/FTCU.kicad_pcb
40402
ECAD/FTCU.kicad_pcb
File diff suppressed because it is too large
Load Diff
|
|
@ -3,8 +3,13 @@
|
|||
"active_layer": 31,
|
||||
"active_layer_preset": "",
|
||||
"auto_track_width": true,
|
||||
"hidden_netclasses": [],
|
||||
"hidden_nets": [],
|
||||
"hidden_netclasses": [
|
||||
"USB"
|
||||
],
|
||||
"hidden_nets": [
|
||||
"/Connections/USB_D-",
|
||||
"/Connections/USB_D+"
|
||||
],
|
||||
"high_contrast_mode": 0,
|
||||
"net_color_mode": 1,
|
||||
"opacity": {
|
||||
|
|
@ -21,7 +26,7 @@
|
|||
"keepouts": true,
|
||||
"lockedItems": false,
|
||||
"otherItems": true,
|
||||
"pads": false,
|
||||
"pads": true,
|
||||
"text": true,
|
||||
"tracks": true,
|
||||
"vias": true,
|
||||
|
|
@ -65,7 +70,7 @@
|
|||
40
|
||||
],
|
||||
"visible_layers": "ffcffff_fffffff9",
|
||||
"zone_display_mode": 0
|
||||
"zone_display_mode": 1
|
||||
},
|
||||
"git": {
|
||||
"repo_password": "",
|
||||
|
|
|
|||
|
|
@ -116,7 +116,7 @@
|
|||
},
|
||||
"rules": {
|
||||
"max_error": 0.005,
|
||||
"min_clearance": 0.15,
|
||||
"min_clearance": 0.1,
|
||||
"min_connection": 0.1,
|
||||
"min_copper_edge_clearance": 0.2,
|
||||
"min_hole_clearance": 0.25,
|
||||
|
|
@ -128,7 +128,7 @@
|
|||
"min_text_height": 0.8,
|
||||
"min_text_thickness": 0.08,
|
||||
"min_through_hole_diameter": 0.3,
|
||||
"min_track_width": 0.15,
|
||||
"min_track_width": 0.1,
|
||||
"min_via_annular_width": 0.1,
|
||||
"min_via_diameter": 0.45,
|
||||
"solder_mask_to_copper_clearance": 0.0,
|
||||
|
|
@ -498,7 +498,7 @@
|
|||
"microvia_diameter": 0.3,
|
||||
"microvia_drill": 0.1,
|
||||
"name": "CAN",
|
||||
"pcb_color": "rgb(194, 194, 0)",
|
||||
"pcb_color": "rgba(0, 0, 0, 0.000)",
|
||||
"schematic_color": "rgb(0, 255, 255)",
|
||||
"track_width": 0.2,
|
||||
"via_diameter": 0.6,
|
||||
|
|
@ -515,7 +515,7 @@
|
|||
"microvia_diameter": 0.3,
|
||||
"microvia_drill": 0.1,
|
||||
"name": "Flash",
|
||||
"pcb_color": "rgb(255, 255, 0)",
|
||||
"pcb_color": "rgba(0, 0, 0, 0.000)",
|
||||
"schematic_color": "rgb(0, 0, 194)",
|
||||
"track_width": 0.2,
|
||||
"via_diameter": 0.6,
|
||||
|
|
@ -532,7 +532,7 @@
|
|||
"microvia_diameter": 0.3,
|
||||
"microvia_drill": 0.1,
|
||||
"name": "HS",
|
||||
"pcb_color": "rgb(194, 194, 0)",
|
||||
"pcb_color": "rgba(0, 0, 0, 0.000)",
|
||||
"schematic_color": "rgb(194, 194, 0)",
|
||||
"track_width": 0.2,
|
||||
"via_diameter": 0.6,
|
||||
|
|
@ -549,7 +549,7 @@
|
|||
"microvia_diameter": 0.3,
|
||||
"microvia_drill": 0.1,
|
||||
"name": "Power",
|
||||
"pcb_color": "rgb(255, 153, 0)",
|
||||
"pcb_color": "rgba(0, 0, 0, 0.000)",
|
||||
"schematic_color": "rgb(255, 0, 0)",
|
||||
"track_width": 0.2,
|
||||
"via_diameter": 0.6,
|
||||
|
|
@ -558,7 +558,7 @@
|
|||
},
|
||||
{
|
||||
"bus_width": 12,
|
||||
"clearance": 0.15,
|
||||
"clearance": 0.1,
|
||||
"diff_pair_gap": 0.25,
|
||||
"diff_pair_via_gap": 0.25,
|
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"diff_pair_width": 0.2,
|
||||
|
|
@ -566,10 +566,10 @@
|
|||
"microvia_diameter": 0.3,
|
||||
"microvia_drill": 0.1,
|
||||
"name": "RAM",
|
||||
"pcb_color": "rgb(68, 255, 255)",
|
||||
"pcb_color": "rgba(0, 0, 0, 0.000)",
|
||||
"schematic_color": "rgb(0, 0, 194)",
|
||||
"track_width": 0.15,
|
||||
"via_diameter": 0.5,
|
||||
"track_width": 0.1,
|
||||
"via_diameter": 0.4,
|
||||
"via_drill": 0.3,
|
||||
"wire_width": 6
|
||||
},
|
||||
|
|
@ -583,7 +583,7 @@
|
|||
"microvia_diameter": 0.3,
|
||||
"microvia_drill": 0.1,
|
||||
"name": "SD",
|
||||
"pcb_color": "rgb(0, 255, 0)",
|
||||
"pcb_color": "rgba(0, 0, 0, 0.000)",
|
||||
"schematic_color": "rgb(0, 0, 194)",
|
||||
"track_width": 0.2,
|
||||
"via_diameter": 0.6,
|
||||
|
|
@ -600,7 +600,7 @@
|
|||
"microvia_diameter": 0.3,
|
||||
"microvia_drill": 0.1,
|
||||
"name": "USB",
|
||||
"pcb_color": "rgb(255, 0, 255)",
|
||||
"pcb_color": "rgba(0, 0, 0, 0.000)",
|
||||
"schematic_color": "rgb(0, 255, 0)",
|
||||
"track_width": 0.2918,
|
||||
"via_diameter": 0.6,
|
||||
|
|
|
|||
|
|
@ -3149,42 +3149,6 @@
|
|||
)
|
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)
|
||||
)
|
||||
(pin bidirectional line
|
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(at -19.05 -12.7 0)
|
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|
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|
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|
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|
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|
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|
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|
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)
|
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)
|
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(pin bidirectional line
|
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|
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|
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|
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(font
|
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(size 1.27 1.27)
|
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|
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|
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|
|
@ -3437,6 +3401,42 @@
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|
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)
|
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(pin bidirectional line
|
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(at -19.05 -12.7 0)
|
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(length 3.81)
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|
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)
|
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|
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|
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|
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|
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|
|
@ -3892,7 +3892,7 @@
|
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|
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49
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49
FTCU.ioc
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
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|
||||
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|
||||
Mcu.Pin31=PE8
|
||||
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|
||||
Mcu.Pin33=PE10
|
||||
Mcu.Pin34=PE11
|
||||
Mcu.Pin35=PE13
|
||||
Mcu.Pin36=PE14
|
||||
Mcu.Pin30=PE9
|
||||
Mcu.Pin31=PE10
|
||||
Mcu.Pin32=PE11
|
||||
Mcu.Pin33=PE12
|
||||
Mcu.Pin34=PE13
|
||||
Mcu.Pin35=PE14
|
||||
Mcu.Pin36=PB10
|
||||
Mcu.Pin37=PB12
|
||||
Mcu.Pin38=PB13
|
||||
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|
||||
|
|
@ -222,13 +222,14 @@ PA13(JTMS/SWDIO).Mode=Trace_Asynchronous_SW
|
|||
PA13(JTMS/SWDIO).Signal=DEBUG_JTMS-SWDIO
|
||||
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|
||||
PA14(JTCK/SWCLK).Signal=DEBUG_JTCK-SWCLK
|
||||
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|
||||
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|
||||
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|
||||
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|
||||
PA8.Signal=RCC_MCO_1
|
||||
PA9.Mode=Activate_VBUS_FS
|
||||
PA9.Signal=USB_OTG_HS_VBUS
|
||||
PB10.Locked=true
|
||||
PB10.Mode=OCTOSPI1_Port1_NCS
|
||||
PB10.Signal=OCTOSPIM_P1_NCS
|
||||
PB12.Mode=FDCAN_Activate
|
||||
PB12.Signal=FDCAN2_RX
|
||||
PB13.Mode=FDCAN_Activate
|
||||
|
|
@ -284,8 +285,10 @@ PD9.Signal=FMC_D14_DA14
|
|||
PE0.Signal=FMC_NBL0
|
||||
PE1.Signal=FMC_NBL1
|
||||
PE10.Signal=FMC_D7_DA7
|
||||
PE11.Mode=OCTOSPI1_Port1_NCS
|
||||
PE11.Signal=OCTOSPIM_P1_NCS
|
||||
PE11.Locked=true
|
||||
PE11.Signal=FMC_D8_DA8
|
||||
PE12.Locked=true
|
||||
PE12.Signal=FMC_D9_DA9
|
||||
PE13.Signal=FMC_D10_DA10
|
||||
PE14.Signal=FMC_D11_DA11
|
||||
PE2.Mode=OCTOSPI1_IOL_Port1L
|
||||
|
|
|
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